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AT84AD001B的应用主要内容•AT84的内部结构•并行交替采样•ADC的配置•配置时序•配置功能AT84的内部结构并行交替采样原理精确时钟控制器ADCADCADCADC数据总线数据重组逻辑并行交替采样系统框图并行交替采样ADC配置—配置时序ADC配置—配置功能寄存器000：702C0111000000101100两通道增益调节不匹配增益补偿微调后高速数据采集电路ADC数据接收LVDS处理逻辑数据重组逻辑FIFO高速数据采集电路高速数据处理逻辑LVDS处理逻辑数据重组逻辑FIFOLVDS接收器的三个功能：(1)接口(2)降速(3)相位调整LVDS处理逻辑16bit16bit128bitLVDS处理逻辑采样时钟数据无相位调整采样相位后调整采样相位调整原理LVDS处理逻辑501001502002506080100120140160180280300320340360380400420050100150200250高速数据采集电路高速数据处理逻辑LVDS处理逻辑数据重组逻辑FIFO高速数据采集电路高速数据处理逻辑LVDS处理逻辑数据重组逻辑FIFO