搜索
.Word资料一、选择题（每题2分，共18分）1、下列关于冯•诺依曼型计算机的描述，不正确的是__C____。A）计算机硬件系统由运算器、存储器、控制器、输入设备、输出设备五大部件组成B）指令和数据在存储器中都是二进制码存储C）指令存储器和数据存储器独立分设在不同的存储器D）存储程序并按地址顺序执行是CPU自动工作的关键2、若机器数为补码，某寄存器中的容为BF(十六进制)，则该寄存器存储的数据真值是__B____(用十进制表示)。A）65B）-65C）64D）-643、下列关于存储器的描述，不正确的是__C____。A）SRAM和DRAM都是易失性存储器B）ROM存储器容是预置的，固定的，无法改写C）多模块交叉存储器主要是解决主存空间不够大的问题D）cache存储器是为了解决CPU和主存之间在速度上不匹配的问题4、下列关于RISC的描述中，不正确的是___C___。A）指令条数比CISC少B）指令长度固定，指令格式种类少，寻址方式种类少C）在程序中出现频率占80%的指令占指令总数的20%D）只有取数/存数指令访问存储器5、设机器数字长为16位，一个容量为32MB的存储器，CPU按半字长寻址，其寻址围是___C____。A）223B）224C）225D）2266、在程序的执行过程中，cache与主存的地址映射是由__D____。A）程序员调度的B）操作系统管理的C）由程序员和操作系统共同协调完成的D）硬件自动完成的7、下列关于指令的描述，不正确的是___A____。A）指令周期是指CPU执行某条指令的时间.Word资料B）一个指令周期常常包含若干个CPU周期C）一个CPU周期包含若干时钟周期D）一条机器指令对应一个微程序，微程序是由若干条微指令序列组成8、在多总线结构中，用于连接高速I/O设备模块的总线是___C____。A）CPU总线B）系统总线C）PCI总线D）ISA总线9、下列关于磁盘存储器的描述，不正确的是___D____。A）数据的写入和读出是合用一个磁头，称为读写磁头B）磁盘控制器是主机和磁盘驱动器之间的接口C）磁盘的道密度指沿磁盘半径方向单位长度上的磁道数D）磁盘记录面外圈的扇区比圈的扇区要长，因此每个扇区记录的信息也要多二、填空题（共30分）1、摩尔定律指的是___芯片单位面积上晶体管的数目___每18个月翻一番。2、SRAM存储器的存储元是____触发器_____，DRAM存储器的存储元是___MOS晶体管和电容器___。3、指令的寻址方式有___顺序___寻址方式和___跳跃___寻址方式两种。4、假设某机器有120条指令，平均每条指令由5条微指令组成，其中有一条取指微指令是所有指令公用的。已知微指令长度位32bit，则控制存储器的容量最少是__15392bit__。5、流水线技术利用的是__时间____并行性，超标量技术利用的是___空间___并行性。6、总线的定时方式中，__异步定时_适用于快速和慢速功能模块都连接到同一总线的情况，__同步定时_适用于总线长度较短、各功能模块速度比较接近的情况。7、总线仲裁方式有___分布式仲裁__和集中式仲裁。集中式仲裁又分为三种，分别是___链式查询方式_，__计数器定时查询方式_，和___独立请求方式__。8、Infiniband是一个高性能的__I/O__标准，是一种基于__开关__的体系结构。9、PCI采用的是___同步___时序协议和___集中式___仲裁策略，其基本传输机制是___猝发式传送___。10、采用串行接口进行字符传送，假设波特率为3600波特，字符传送速率为400字符/秒，则每个字符包含___9___bit。.Word资料11、读写操作时，磁盘是恒_角速_旋转，光盘是恒_线速_旋转。12、某磁盘存储器有20个可用盘面，每个盘面有200个磁道，每个磁道均记录18000B信息，最小磁道直径是240mm，最大磁道直径是340mm，是则该磁盘存储器的道密度为____4道/mm_，柱面数为___200_，磁盘总容量为__72000000B__。13、某磁盘存储器转速为6000RPM，平均找道时间为12ms，数据传输率为1KB/ms，则读出磁盘上连续存放的1MB数据需要的平均时间是__1041ms__。三、简答题（每题3分，共12分）2、什么是程序的局部性原理？程序总是趋向于使用最近使用过的数据和指令，包括程序的时间局部性和程序的空间局部性。1）程序的时间局部性：指程序即将用到的信息可能就是目前正在使用的信息。2）程序的空间局部性：指程序即将用到的信息可能与目前正在使用的信息在空间上相邻或者临近。4、在多总线结构中有三种总线（HOST总线、PCI总线和LEGACY总线）和三种桥（北桥、南桥和PCI/LEGACY桥），请说出这三种桥分别连接的是哪些总线？北桥连接HOST总线和PCI总线，南桥连接PCI总线和PCI总线，PCI/LEGACY桥连接PCI总线和LEGACY总线。四、设有浮点数x=23×(+11/16)，y＝24×(-13/16)，阶码用4位（含一位符号位）补码表示，尾数用5位（含一位符号位）补码表示，求真值x/y=？要求（1）写出x，y的浮点数表示，（2）用补码加减交替法完成尾数除法运算。（1）11/16=0.1011，故x的浮点数表示为001101011-13/16=1.1101，故y的浮点数表示为010010011（2）现依然用x和y表示其尾数，则x=0.1011，y=-0.1101，用补码加减交替法进行x/y的尾数运算如下：1.微操作命令和微操作答：微操作命令是控制完成微操作的命令；微操作是由微操作命令控制实现的最基本操作。2.快速缓冲存储器答：快速缓冲存储器是为了提高访存速度，在CPU和主存之间增设的高速存储器，它对用户是透明的。只要将CPU最近期需用的信息从主存调入缓存，这样CPU每次只须访问快速缓存就可达到访问主存的目的，从而提高了访存速度。.Word资料五、有一个2048K×16位的存储器，由若干片256K×8位的DRAM芯片构成。问：（1）需要多少片DRAM芯片？（2）该存储器需要多少字节地址位？（3）画出该存储器与CPU连接的结构图，设CPU的接口信号有地址信号、数据信号、控制信号MREQ#和R/W#。（1）需要DRAM芯片数=2048K×16位/(256K×8位)=16（2）该存储器容量为2048K×16位=4096KB，4096K=212，故需要12个字节地址位(22)（3）存储器与CPU连接的结构图256Kx82片256Kx82片256Kx82片256Kx82片3：8译码器D15~D0A18-20CPUA20-0MREQ#R/W#D15~D0D15~D0D15~D0D15~D0A17-0....Word资料七、设某机的指令格式、有关寄存器和主存容如下，X为寻址方式，D为形式地址，请在下表中填入有效地址E及操作数的值。OPXD=100PC=500R基=1000200400800600X有效地址E操作数寻址方式0立即寻址1直接寻址2间接寻址3相对寻址4变址寻址内存1002006001100请填写表中有效地址和操作数：指令格式答案如下：OPXD=100PC=500R基=1000200400800600X有效地址E操作数寻址方式0不需要寻址100立即寻址1100200直接寻址2200400间接寻址3600800相对寻址41100600变址寻址内存1002006001100请填写表中有效地址和操作数：指令格式八、下图所示为单总线CPU部框图，其中R0～R3为通用寄存器，ALU具有加、减运算功能。完成下列问题：（10分）1）说明图中IR,PC,AR,DR,Y,Z寄存器的作用。2）画出加法指令SUBR1,(R2)的指令周期流程图，其中“(Ri)”表示寄存器间接寻址，指令左边的操作数为目的操作数。.Word资料答案如下：1）IR为指令寄存器，PC为程序计数器，AR为存地址暂存器，DR为存数据暂存器，Y用于暂存ALU的一个操作数，Z用于暂存ALU的运算结果。2）SUBR1,(R2)的指令周期流程图如下：2、当机器字长一定时，__B_____越长，浮点数表示的围越大，精度越低。A）阶符B）阶码C）尾符D）尾数3、下列关于cache地址映射的描述，不正确的是___D___。A）全相联映射方式中，主存的一个块可能存放到cache中任意一行B）直接映射方式中，主存的一个块只能存放在cache的一个特定行C）全相联映射方式的cache利用率高，直接映射方式的cache利用率低D）组相联映射方式是全相联映射和直接映射方式的折中方案，即主存中的一个块放到cache的哪个组是灵活的，而放到该组的哪个行是固定的。.Word资料4、CPU响应中断的时间是___C____。A）中断源提出请求B）取指周期结束C）执行周期结束D）间址周期结束5、分支预测的目的是为了___D____。A）提高转移指令的执行速度B）提高每条指令的流水执行速度C）提高程序的正确性D）提高指令预取的成功率6、在堆栈寻址中，设A为累加器，SP为堆栈指示器，Msp为SP指示的栈顶单元。如果进栈操作顺序是：（SP）-1→SP，（A）→Msp；那么出栈操作的顺序应是___A____。A）（Msp）→A，（SP）+1→SPB）（SP）+1→SP，（Msp）→AC）（SP）-1→SP，（Msp）→AD）（Msp）→A，（SP）-1→SP7、中断处理过程中，___A____是由硬件完成。A）关中断B）开中断C）保存CPU现场D）恢复CPU现场8、下列说法中正确的是___D____。A）多体交叉存储器主要解决扩充容量问题。B）Cache地址空间是主存地址空间的一部分。C）主存都是由易失性的随机读写存储器构成的。D）Cache的功能全部由硬件实现。9、计算机操作的最小单位时间是___A____。A）时钟周期B）指令周期C）CPU周期D）中断周期。.Word资料1、若机器数为补码，某寄存器中的容为BF(十六进制)，则该寄存器存储的数据真值是__-65___(用十进制表示)。2、多模块交叉存储器中，地址在模块中的安排方式有__顺序__和__交叉__两种。3、已知cache存储周期为20ns，主存存储周期为220ns，cache/主存系统平均访问时间为60ns，则cache命中率是__80%___。4、假设某机器有120条指令，平均每条指令由5条微指令组成，其中有一条取指微指令是所有指令公用的。已知微指令长度位32bit，则控制存储器的容量最少是__15392bit__。5、流水线中存在的三种相关冲突分别是_资源相关_，_数据相关__和__控制相关6、按总线仲裁电路的位置不同，总线总裁分为__集中式__仲裁和_分布式__仲裁。7、设字长8位（含1位符号位），则原码定点小数能表示的绝对值最大负数是__-（1-2-7）8、在组合逻辑控制器中，微操作控制信号由_时序_、_状态条件_和_指令决定。9、已知有四位数P1P2P3P4采用偶校验，其校验位C的表达式为__P1异或P2异或P3异或P4__。10、在不改变中断响应优先级次序的条件下，通过__中断屏蔽__可以改变中断处理次序。三、浮点数标准IEEE754的规格化数表示方式为(-1)s*1.m*2e-127，其中s为符号位，m为尾数，e为阶码，32位浮点数的s、e、m分别占1，8，23bit，请写出下列十进制数的IEEE754标准的32位浮点规格化数。(1)25/64(2)-35/128答：25/64=(0.00011001)2=(1.1001x2-4)2-35/64=(-0.00100011)2=(-1.00011x2-3)2故25/64的IEEE754标准的32位浮点规格化数为：0,01111011,10010000000000000000000-35/64的IEEE754标准的32位浮点规格化数为：1,00111110,00011000000000000000000四、已知x=0.1011，y=－0.1101，求x÷y（用补码加减交替法进行运算）。