时序逻辑电路练习题

1一、填空题1.基本RS触发器，当R、S都接高电平时，该触发器具有_______功能。2．D触发器的特性方程为___；J-K触发器的特性方程为______。3．T触发器的特性方程为。4．仅具有“置0”、“置1”功能的触发器叫。5．时钟有效边沿到来时，输出状态和输入信号相同的触发器叫_________。6.若D触发器的D端连在Q端上，经100个脉冲作用后，其次态为0，则现态应为。7．JK触发器J与K相接作为一个输入时相当于触发器。8.触发器有个稳定状态，它可以记录位二进制码，存储8位二进制信息需要个触发器。9．时序电路的次态输出不仅与即时输入有关，而且还与有关。10.时序逻辑电路一般由和两部分组成的。11.计数器按内部各触发器的动作步调，可分为______计数器和______计数器。12.按进位体制的不同，计数器可分为计数器和计数器两类；按计数过程中数字增减趋势的不同，计数器可分为计数器、计数器和计数器。13．要构成五进制计数器，至少需要级触发器。14．设集成十进制（默认为8421码）加法计数器的初态为Q4Q3Q2Q1＝1001，则经过5个CP脉冲以后计数器的状态为。15．将某时钟频率为32MHz的CP变为4MHz的CP，需要个二进制计数器。16.在各种寄存器中，存放N位二进制数码需要个触发器。17.有一个移位寄存器，高位在左，低位在右，欲将存放在该移位寄存器中的二进制数乘上十进制数4，则需将该移位寄存器中的数移位，需要个移位脉冲。18．某单稳态触发器在无外触发信号时输出为0态，在外加触发信号时，输出跳变为1态，因此其稳态为态，暂稳态为态。19．单稳态触发器有____个稳定状态，多谐振荡器有____个稳定状态。20．单稳态触发器在外加触发信号作用下能够由状态翻转到状态。21．集成单稳态触发器的暂稳维持时间取决于。22.多谐振荡器的振荡周期为T=tw1+tw2，其中tw1为正脉冲宽度，tw2为负脉冲宽度，则占空比应为_______。23．施密特触发器有____个阈值电压，分别称作________和________。24．触发器能将缓慢变化的非矩形脉冲变换成边沿陡峭的矩形脉冲。25．施密特触发器常用于波形的与。二、选择题1.R-S型触发器不具有()功能。A.保持B.翻转C.置1D.置02.触发器的空翻现象是指（）A.一个时钟脉冲期间，触发器没有翻转B.一个时钟脉冲期间，触发器只翻转一次C.一个时钟脉冲期间，触发器发生多次翻转D.每来2个时钟脉冲，触发器才翻转一次3.欲得到D触发器的功能，以下诸图中唯有图（A）是正确的。24.对于JK触发器，若希望其状态由0转变为1，则所加激励信号是()A.JK=0XB.JK=X0C.JK=X1D.JK=1X5.电路如图所示，D触发器初态为0，则输出波形为(B)。6.下列触发器中不能用于移位寄存器的是()。A.D触发器B.JK触发器C.基本RS触发器D.负边沿触发D触发器7.下面4种触发器中，抗干扰能力最强的是()A.同步D触发器B.主从JK触发器C.边沿D触发器D.同步RS触发器8.为使触发器可靠地翻转，输入信号必须先于时钟信号有效，这段时间间隔称为()。A.延迟时间B.保持时间C.建立时间D.转换时间9．按各触发器的CP所决定的状态转换区分，计数器可分为（）计数器。A．加法、减法和可逆B．同步和异步C．二、十和M进制10.触发器是一种（）。A、单稳态电路B、双稳态电路C、无稳态电路11.至少()片74197（集成4位二进制计数器）可以构成M=1212的计数。A.12B.11C.3D.212．555定时器组成的多谐振荡器属于（）电路。A．单稳B．双稳C．无稳13．能起到定时作用的电路是（）A．施密特触发器B．双稳态触发器C．多谐振荡器D．单稳态触发器14．模为64的二进制计数器，它有（）位触发器构成。A.64B.6C.8D.3215．555定时器电源电压为VCC，构成施密特触发器其回差电压为()A.VCCB.21VCCC.32VCCD.311VCC16.下列时序电路的状态图中，具有自启动功能的是(B)317.多谐振荡器与单稳态触发器的区别之一是()A.前者有2个稳态，后者只有1个稳态B.前者没有稳态，后者有2个稳态C.前者没有稳态，后者只有1个稳态D.两者均只有1个稳态，但后者的稳态需要一定的外界信号维持18.555构成的单稳态触发器的触发脉冲宽度ti与暂稳态维持时间tw之间应满足()。A.titwB.ti=twC.titwD.没有关系19．在以下各种电路中，属于时序电路的有（）。A．ROMB．编码器C．寄存器D．数据选择器三、判断题1.一个5位的二进制加法计数器，由00000状态开始，经过169个输入脉冲后，此计数器的状态为01001。2.即使电源关闭，移位寄存器中的内容也可以保持下去。3.所有的触发器都能用来构成计数器和移位寄存器。4.移位寄存器74LS194可串行输入并行输出，但不能串行输入串行输出。5.二进制计数器既可实现计数也可用于分频。6.同步计数器的计数速度比异步计数器快。7.同步计数器与异步计数器的主要区别在于它们内部的触发器是否同时发生翻转。8.由N个触发器构成的计数器，其最大的计数范围是N2。9.在计数器电路中，同步置零与异步置零的区别在于置零信号有效时，同步置零还要等到时钟信号到达时才能将触发器置零，而异步置零不受时钟的控制。10.计数器的异步清零端或置数端在计数器正常计数时应置为无效状态。11.时序电路通常包含组合电路和存储电路两个组成部分，其中组合电路必不可少。12.任何一个时序电路，可能没有输入变量，也可能没有组合电路，但一定包含存储电路。13.自启动功能是任何一个时序电路都具有的。14.一组4位二进制数要串行输入移位寄存器，时钟脉冲频率为1kHZ，则经过4ms可转换为4位并行数据输出。15.若4位二进制减量计数器的初始状态为1000，则经过100个CP脉冲作用之后的状态为0100。16.当用异步清零端来构成M进制计数器时，一定要借助一个过渡状态M来实现反馈清零。17.当用同步清零端来构成M进制计数器时，不需要借助过渡状态就可以实现反馈清零。18.若用置数法来构成任意N进制计数器，则在状态循环过程中一定包含一个过渡状态，该状态同样不属于稳定循环状态的范围。19.无论是用置零法还是用置数法来构成任意N进制计数器时，只要是置零或4置数控制端是异步的，则在状态循环过程中一定包含一个过渡状态；只要是同步的，则不需要过渡状态。四、分析设计题1、分析下图所示时序电路的逻辑功能。要求：（1）写出电路的驱动方程、状态方程和输出方程；（2）画出电路的状态转换图，并说明电路能否自启动。2、JK触发器及CP、J、K、DR的波形分别如图37（a）、（b）所示，试画出Q端的波形。（设Q的初态为“0”）SR1J1KCP“1”DRQQJKDRCP3、D触发器及输入信号D、DR的波形分别如图38（a）、（b）所示，试画出Q端的波形。（设Q的初态为“0”）R1DCPDRQQDDCPDR4、设下图中各触发器的初始状态皆为Q=0，试求出在CP信号连续作用下各触发器的次态方程。55、分析下图中的计数器电路，说明这是多少进制的计数器。十进制计数器74160的功能表如表43所示。6、分析下图中的计数器电路，画出电路的状态转换图，说明这是多少进制的计数器。十六进制计数器74161的功能表如表44所示。67、下图是由两片同步十进制可逆计数器74LS192构成的电路，74LS192的真值表如附表1.2.1所示。求：1、指出该电路是几进制计数器；2、列出电路状态转换表的最后一组有效状态。8、试分析下图中所示电路，说明它是几进制计数器。1、解：（1）驱动方程：31QD，12QD，123QQD7状态方程：311QQn，112QQn，1213QQQn输出方程：31QQY（2）状态转换图如附图1.6.10所示。电路能够自启动。2、解：Q端的波形如下图所示：3、解：Q端的波形如图38－1：QDCPDR4、解：nnQQ111nnQQ212nnQQ313nnQQ414nnQQ515012nQnnQQ717nnQQ818111nQnnQQ10110nnQQ111111112nQ5、解：七进制计数器。6、解：这是一个十进制计数器。JKDRCPQ87、解：1、22进制计数器；2、最后一组有效状态是：00100001。8、解：这是使用整体反馈置零法构成的计数器。当计数器计到1010111011112222ABCDABCDQQQQQQQQ时，检测门输出0，74161异步置零。因此该计数器的有效状态是从00000000～10101101，中间无空缺状态。因此该计数器是一个模174计数器。